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[IT뉴스]램쉽, 중기부 '글로벌 팁스' 선정…112G 이더넷 PHY 개발 착수

온카뱅크관리자

2026-08-14 13:57:32

<div id="layerTranslateNotice" style="display:none;"></div> AI 데이터센터용 고속 인터페이스 핵심기술 확보 추진…산학연 공동연구 착수 
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 아날로그·혼성신호 반도체 설계기업 램쉽(대표 고재간)이 서울대학교, 서울시립대학교, 한국전자기술연구원(KETI)과 손잡고 인공지능(AI) 인프라용 112G 이더넷 PHY 핵심기술 개발에 나선다.
 램쉽은 'AI 스케일업 네트워크를 위한 112G Ethernet PHY 개발' 과제가 중소벤처기업부 투·융자 연계 기술개발사업인 '글로벌 팁스(일반형)' 연구개발(R&amp;D) 지원 대상으로 선정됐다고 밝혔다.
 생성형 AI와 고성능 컴퓨팅 확산으로 데이터센터가 처리하는 데이터양이 증가하면서 반도체와 네트워크 장비 간 대용량 데이터를 빠르고 안정적으로 전송하는 고속 인터페이스 기술의 중요성이 커지고 있다.
 이더넷 PHY는 디지털 데이터를 실제 전기신호로 변환해 송수신하는 물리계층 반도체 기술이다. 채널당 112Gbps급 전송 환경에서는 신호 손실과 잡음, 전력 소모를 최소화하는 회로 설계와 함께 설계 단계에서 시스템 전체의 성능과 동작을 검증하는 기술이 요구된다.
 램쉽은 아날로그·혼성신호 반도체와 고속 직렬 송수신(SerDes) 설계 역량을 기반으로 이번 과제를 주도한다. 서로 다른 반도체 공정에서도 재사용할 수 있는 아날로그 회로 설계 기술과 AI 기반 회로 최적화 기술을 활용해 설계 효율과 기술 완성도를 높일 계획이다.
 이번 사업에는 벤처캐피탈 노틸러스인베스트먼트가 운영사로 참여해 투자와 후속 투자 연계, 글로벌 사업화를 지원한다. 기업성장지원기관 특허법인 이오는 112G 이더넷 PHY와 AI 네트워크 관련 지식재산권(IP) 전략 수립을 비롯해 국내외 특허 확보, 해외 권리화, 라이선스 및 기술이전 연계를 지원한다.
 공동연구기관도 각 분야 전문성을 바탕으로 기술 개발에 참여한다. 서울대학교 김재하 교수 연구팀은 아날로그·혼성신호 회로와 고속 인터페이스 분야의 설계·검증 자동화 역량을 활용해 112G 이더넷 PHY 모델링과 시뮬레이션 기반 시스템 검증을 수행한다.
 서울시립대학교 문용삼 교수 연구팀(집적시스템연구실)은 초고속 데이터 인터페이스와 PAM-4 송수신기, 위상고정루프(PLL) 설계 역량을 바탕으로 초저잡음 클로킹 회로 기반 송수신기 연구를 맡는다. KETI 연구진도 112G 이더넷 PHY 관련 연구개발에 참여한다.
 램쉽은 기업과 대학, 연구기관의 역량을 결합해 회로 설계부터 모델링, 시뮬레이션, 시스템 검증까지 아우르는 개발 체계를 구축할 방침이다. 확보한 기술은 향후 AI 데이터센터와 고성능 네트워크 분야에 적용할 계획이다.
 고재간 램쉽 대표는 “AI 기술 발전으로 데이터를 처리하는 반도체뿐 아니라 대규모 데이터를 고속으로 연결하는 인터페이스 기술의 중요성도 커지고 있다”며 “이번 산학연 공동연구를 통해 112G 이더넷 PHY 핵심기술을 확보하고 글로벌 AI 인프라 시장에서 활용할 수 있는 반도체 IP로 발전시켜 나가겠다”고 말했다.
 램쉽은 경기도 성남시에 위치한 RF·아날로그·혼성신호 반도체 설계기업이다. 고속 SerDes와 ADC 기반 인터페이스, 공정 이식형 아날로그 회로 생성, AI 기반 회로 최적화 기술 등을 개발하고 있다.
 이번 연구개발은 중소벤처기업부와 중소기업기술정보진흥원이 지원하는 글로벌 팁스 R&amp;D 사업의 일환으로 추진된다.
 임민지 기자 minzi56@etnews.com
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